Diff for "CLIO/Tasks/DigitalControl/AnalogFrontEnd"

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デジタル化第１段のためのアナログ回路試作

1. 19インチラックケース発注 with 穴あけ加工

2009/01/26 発注
発注先
ケース納入 (2009/02/18) --> 完了

1.1 Dsub ケーブル発注 to misumi

2009/01/27 ミスミのカタログ --> 発注
納入 (2009/02/03) --> 完了

2. Whitening / De-whitening filter (NIM) の製作

回路設計・試作機性能評価
試作回路性能評価終了 (2009/02/04)
3.5nV/rtHz @ 20Hz / Whitening filter input
5.0nV/rtHz @ 20Hz / De-Whitening filter output
実機性能評価 --> 完了

3. Logic Output Module (NIM)

デジタルシステムなしでも当面使えるように、手動ボタン付。
--> TAMA 既存モジュールを使用。

4. AA/AI module 試作

この回路はAA/AI/differential driverを兼ねる。Dsub9 入力１ --> Dsub 出力１　のユニットを試作。
参考資料:LIGO circuit / 回路 hacking by 新井/Board Test Report in LIGO
AA/AI 2モジュール製作 (due:2009/5/End)
- 4回路入りモジュール試作: Done @ 2009/08/28, 回路図
- To do: NIM moduleに組み込む場合のために+/-15Vの3端子レギュレーターの穴と配線をつける

5. Differential Signal Receiver 試作

4回路入りモジュール試作: Done @ 2009/??/??, 回路図

6. ADC / DAC interface 製作

コネクタ発注済 --> コネクタ納入 (2009/02/03)
コネクタ設置基板のレイアウト --> 基板納入 (2009/02/20)
システムが NAO に来たら check <-- 宮川 5月の Caltech 出張時に配線確認。
回路図
- ADC/SCSI 80pin interface
- DAC/SCSI 68pin interface(D0900060)
- Dsub interface for DAC
- Dsub interface for ADC(D0900059), (2009/11/17, 最初DAC用と共通であったが、ピン配置が反転することが判明したためADC用を作り直した)

7. Variable Gain Amp. 試作

デジタル・エンコード部分も切り離すことにした試作機を作る。
基板発注(2009/02/25) --> 納入(2009/03/05)
試作機２台製作

8. Variable Gain Encoder 試作

デジタル・エンコード部分の試作機を作る。
Pending

以上、年度内。

参考文献

CLIO/Tasks/DigitalControl/AnalogFrontEnd (last edited 2011-06-17 00:32:37 by OsamuMiyakawa)

-  ⇤ ← Revision 32 as of 2009-02-05 16:36:17 → 
  Size: 1357
  Editor: whitehole
  Comment:
+   ← Revision 81 as of 2010-07-14 12:01:28 → ⇥
  Size: 3629
  Editor: DaisukeTatsumi
  Comment:
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+Additions are marked like this.
 Line 1:
-優先順位付

'''1. 19インチラックケース発注 with 穴あけ加工 '''
+## page was renamed from CLIO/Plans/DigitalControl/AnalogFrontEnd
== デジタル化第１段のためのアナログ回路試作 ==
'''--(1. 19インチラックケース発注 with 穴あけ加工)-- '''
 Line 6:
+ . [[attachment:Takachi-11-59.pdf|発注先]]
 . ケース納入 (2009/02/18) --> '''完了'''
-Line 7:
+Line 9:
-'''1.1 Dsub ケーブル発注 to misumi '''
+'''--(1.1 Dsub ケーブル発注 to misumi)-- '''
-Line 12:
+Line 14:
-'''2. Whitening / De-whitening filter (NIM) の製作'''
+<<Anchor(WW)>>
'''--(2. Whitening / De-whitening filter (NIM) の製作)--'''
-Line 14:
+Line 17:
- . [[attachment:clio_pede_0901.pdf|方針・回路設計]]
+ . [[attachment:clio_pede_0901.pdf|回路設計・試作機性能評価]]
 . 試作回路性能評価終了 (2009/02/04) <<BR>> '''3.5nV/rtHz @ 20Hz / Whitening filter input'''<<BR>> '''5.0nV/rtHz @ 20Hz / De-Whitening filter output'''
-Line 16:
+Line 20:
- . 試作回路性能評価終了 (2009/02/04)  <<BR>>
 '''3.5nV/rtHz @ 20Hz / Whitening filter input'''<<BR>>
 '''5.0nV/rtHz @ 20Hz / De-Whitening filter output'''
+ . [[attachment:clio_pede_tf_090303.pdf|実機性能評価]] --> '''完了'''
<<BR>>
   . [[http://gw.icrr.u-tokyo.ac.jp/cgi-bin/DocDB/ShowDocument?docid=132|Whitening filter 回路図・ボードレイアウト]]
   . [[attachment:pban_tatsu_090216.zip|De-Whitening filter 回路図・ボードレイアウト]]
-Line 20:
+Line 25:
-'''3. Logic Output Module (NIM)'''
+'''--(3. Logic Output Module (NIM))--'''
-Line 22:
+Line 27:
- . デジタルシステムなしでも当面使えるように、手動ボタン付。 --> '''TAMA 既存モジュールを使用'''。
+ . デジタルシステムなしでも当面使えるように、手動ボタン付。
 --> '''TAMA 既存モジュールを使用'''。
-Line 24:
+Line 30:
-. AA/AI module 試作
+<<Anchor(AA)>>
'''--(4. AA/AI module 試作)--'''
 *この回路はAA/AI/differential driverを兼ねる。Dsub9 入力１ --> Dsub 出力１　のユニットを試作。
 * 参考資料:[[attachment:D070081-01-C.pdf|LIGO circuit]] / [[attachment:AdL_AA_circuit.pdf|回路 hacking by 新井]]/[[attachment:T0700146-00-C.pdf|Board Test Report in LIGO]]
 * ''AA/AI 2モジュール製作 (due:2009/5/End) ''
  * 4回路入りモジュール試作: Done @ 2009/08/28, [[http://gw.icrr.u-tokyo.ac.jp/cgi-bin/DocDB/ShowDocument?docid=61|回路図]]
  * To do: NIM moduleに組み込む場合のために+/-15Vの3端子レギュレーターの穴と配線をつける
-Line 26:
+Line 38:
- . Dsub9 入力１ --> Dsub 出力１　のユニットを１つ試作。<<BR>>
 [[attachment:D070081-01-C.pdf]]
+<<Anchor(DR)>>
'''--(5. Differential Signal Receiver 試作)--'''
 * 4回路入りモジュール試作: Done @ 2009/??/??, [[http://gw.icrr.u-tokyo.ac.jp/cgi-bin/DocDB/ShowDocument?docid=67|回路図]]
-Line 29:
+Line 42:
-'''5. ADC / DAC interface 製作'''
-Line 31:
+Line 43:
- . コネクタ発注済
 . コネクタ納入 (2009/02/03)
 . コネクタ設置基板のレイアウト中
+<<Anchor(SCSI)>>
'''--(6. ADC / DAC interface 製作)--'''
-Line 35:
+Line 46:
-. Variable Gain Amp. 試作
+ . コネクタ発注済 --> コネクタ納入 (2009/02/03)
 . コネクタ設置基板のレイアウト --> 基板納入 (2009/02/20)
 . システムが NAO に来たら check <-- --(宮川 5月の Caltech 出張時に配線確認。)--

 * 回路図
  *[[attachment:aa_adc_1.zip|ADC/SCSI 80pin interface]]
  *[[http://gw.icrr.u-tokyo.ac.jp/cgi-bin/DocDB/ShowDocument?docid=60|DAC/SCSI 68pin interface(D0900060)]]
  *[[attachment:aa_adc_2.zip|Dsub interface for DAC]]
  *[[http://gw.icrr.u-tokyo.ac.jp/cgi-bin/DocDB/ShowDocument?docid=59|Dsub interface for ADC(D0900059)]], (2009/11/17, 最初DAC用と共通であったが、ピン配置が反転することが判明したためADC用を作り直した)



'''--(7. Variable Gain Amp. 試作)--'''
-Line 38:
+Line 61:
+ . 基板発注(2009/02/25) --> 納入(2009/03/05)
 . 試作機２台製作
<<BR>>
 . [[attachment:vga_sch.pdf|VGA 回路図]]
 . [[attachment:pban_vga_090225.zip|pban 発注図面]]
-Line 39:
+Line 67:
-. Variable Gain Encoder 試作
+'''8. Variable Gain Encoder 試作'''
-Line 42:
+Line 70:
+ . ''Pending ''
-Line 43:
+Line 72:
+以上、年度内。
-Line 44:
+Line 74:
-以上、年度内。
+'''参考文献'''

 . [[attachment:T080321-00-C.pdf]]
 . [[attachment:T080328-00-C.pdf]]